NIMF02
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客戶收到合同查閱同意后回傳并按照合同銷售額匯款到公司行流程。
系統(tǒng)組成及供電電路
本信號處理系統(tǒng)采用的是ADl公司的TS201S型ADSP組成的多片某仿真雷達(dá)信號處理系統(tǒng).系統(tǒng)主要由5個DSP、1個FPGA和7個TPS54350組成。在以往使用的MAXl951和。PEGlll7的經(jīng)驗基礎(chǔ)上.經(jīng)過多方面的設(shè)計考慮,采用了TPS54350型DC/DC變換器.從表1可以看出.TPS54350可以輸出3.3 V、2.5 V和1.2V的電壓。系統(tǒng)中的DSP采用240 MHz時鐘,每個指令周期約為4.17 ns。根據(jù)TS201S型ADSP的工作條件可知,當(dāng)溫度為25℃、時鐘CCLK(為250 MHz時,典型情況下的VDD(1.25V)供電電流典型值為1.2 A,VDD的供電電流小于137 mA。TPS54350的額定輸出電壓為3 A.所以此系統(tǒng)的設(shè)計是合理的。
TigerShar DSP有3個電源,其中數(shù)字2.5 V(VDD_Io)為I/0供電;數(shù)字1.2 V(VDD)為DSP內(nèi)核供電;模擬1.2 V(VDD_A)內(nèi)部鎖相環(huán)和倍頻電路供電。系統(tǒng)將主機提供的5V,經(jīng)過TPS54350得到2.5V和1.2 V的電壓。各片DSP的數(shù)字1.2V(VDD)電源各由1個TPS54350供給。5個。DSP內(nèi)部模塊1.2V(VDD)由同一個。DSP的VDD(+1.2V)經(jīng)濾波網(wǎng)絡(luò)后解決。5個。DSP的FO 2.5V電源直接由主機提供的5V經(jīng)過TPS54350得到2.5V統(tǒng)一供給,同時提供FPGA(EPU1。K30)的VccM(+2.5 V)電壓。其中FPGA的Vcc_IO(+3.3V)利用TPS54350輸出的+3.3V電壓來供電。本系統(tǒng)的供電電路框圖如圖2所示。圖3示出單個DSP的內(nèi)核供電電路框圖及外圍電路配置。
T37S54350采用小型16引腳HTSSOP封裝。根據(jù)以往的經(jīng)驗,建議設(shè)計PC板時給TPS54350加上散熱片,電源線盡量粗一點。在TPS54350的前后均加上濾波網(wǎng)絡(luò),盡量保證得到比較合適的電壓。
3BSE031155R1
3BSE018103R1
3BSE030220R1
3BSE018106R1
3BSE026055R1
3BSE018144R1
3BSE018135R1
3BSE032444R1
3BUA000037R1
3BUA000111R1
3BSE040795R1
3BSE043660R1
3BSE048845R1
3BSE056767R1
3BSE051129R1
3BSE056899R1
3BSE066485R1
3BSE066490R1
3BSE066495R1
3BSE018157R1
3BSE018160R1
3BSE018161R1
3BSE018164R1
3BSE031151R1
3BSE031150R1
3BSE050198R1
3BSE050199R1
3BSE053241R1
3BSE053242R1
3BSE018172R1
3BSE018173R1
3BSC950193R1
3BSC950194R1
3BSC950263R1
3BSE057022R1